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管理人の独り言(ほとんど月報状態)

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2005-06-04 [土] Verilog-HDL

_ とりあえず

何とか完成。ソースだけですが(^_^;) で、次の作業は、デバイスに、自分が使い易い順番で入出力ピンを割り当て行くんですが、コンパイルしてやるとエラー発生。どうも、割り当て方が悪くて、回路が組めなくなるっぽいです。

しょうがないので、お任せで割り当てさせて、結果を見ると・・・、こりゃいくらなんでも、使い勝手悪すぎ、っていう順番で割り振ってくれました。どうしたものやら(T_T)

本日のツッコミ(全2件) [ツッコミを入れる]
_ okamal (2005-06-07 [火] 12:29)

さらにその割り振りをなおすための回路を組むとか・・・(^^;;

_ 管理人 (2005-06-07 [火] 17:01)

そうだね〜。って、ちょっとマテ(^_^;)

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